MIPSFPGA - Um Simulador MIPS Incremental com Validação em FPGA

Authors

  • Jeronimo Costa Penha UFV
  • Geraldo Fontes UFV
  • Ricardo Ferreira UFV

DOI:

https://doi.org/10.5753/ijcae.2016.4871

Abstract

Este artigo apresenta inovações no ensino da arquitetura do processador MIPS com apoio de um simulador gráfico. O ambiente proposto, denominado MIPSFPGA (Mips Incremental Processor Simulator and Fpga Prototyping), além da interface gráfica para visualização do caminho de dados das diversas implementações do MIPS com e sem pipeline, o MIPSFPGA inclui vários recursos adicionais. Primeiro, o projeto pode ser editado graficamente para explorar outras implementações. Todos os projetos do livro Organização de Computadores de Patterson e Hennessy são disponibilizados. O projeto pode ser exportado e prototipado em FPGA. As implementações podem ser depuradas durante a simulação e a prototipação. Finalmente, a metodologia é incremental, permitindo começar com uma simples apresentação dos exemplos até a personalização e derivação de novas implementações e extensões.

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Published

2016-12-01

Como Citar

Penha, J. C., Fontes, G., & Ferreira, R. (2016). MIPSFPGA - Um Simulador MIPS Incremental com Validação em FPGA. International Journal of Computer Architecture Education, 5(1), 19–25. https://doi.org/10.5753/ijcae.2016.4871

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